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Verilog HDL是一种硬件描述语言（HDL:Hardware Description Language），以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。

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本例程详细介绍了如何在FPGA上实现Serial RapidIO（SRIO）通信协议，并通过Verilog语言进行编程设计。SRIO作为一种高速、低延迟...

2025-11-12 标签：FPGA 通信协议 Verilog 5.1k 0

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2025-10-22 标签：FPGA 存储器 sram 4k 0

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2025-08-16 标签：FPGA Verilog 数字电压表 5.1k 0

借助Verilog，在FPGA中实现了带编码器的两台电机的电机控制系统的RTL级设计。

2025-07-07 标签：FPGA 机器人 Verilog 2.6k 0

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2025-05-03 标签：模块 Verilog 函数 1.3k 0

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2025-04-18 标签：仿真 Verilog 时序 935 0

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2025-04-11 标签：模块 Verilog 波形 866 0

Verilog HDL语言和C语言一样也提供了编译预处理的功能。“编译预处理”是Verilog HDL编译系统的一个组成部分。Verilog HDL语言...

2025-03-27 标签：FPGA Verilog C语言 1.1k 0

线网类型表示硬件电路元件之间实际存在的物理连线，有很多种：wire、tri、wor等等，当然日常使用wire最多，其他的都没遇到过。

2025-03-27 标签：FPGA 集成电路 Verilog 1.2k 0

CRC即循环冗余校验码：是数据通信领域中最常用的一种查错校验码，其特征是信息字段和校验字段的长度可以任意选定。循环冗余检查（CRC）是一种数据传输检错功...

2025-03-24 标签：crc Verilog 校验码 2.2k 0

边沿检测经常用于按键输入检测电路中，按键按下时输入信号 key 变为低电平，按键抬起变为高电平。当输入的信号为理想的高低电平时（不考虑毛刺和抖动），边沿...

2025-03-19 标签：寄存器 Verilog 边沿检测 1.2k 0

Verilog HDL（Hardware Description Language）是一种硬件描述语言，用于从算法级、门级到开关级的多种抽象设计层次的数...

2025-03-17 标签：FPGA 寄存器 Verilog 3.8k 0

根据下面的时序图实现这个组合逻辑电路。

2025-02-17 标签：Verilog 波形图组合逻辑电路 935 0

Verilog和VHDL是两种广泛使用的硬件描述语言（HDL），它们用于描述和模拟数字电路系统的行为和结构。这两种语言的主要作用是帮助工程师设计、仿真和...

2025-02-17 标签：集成电路 Verilog vhdl 2.7k 0

SPI = Serial Peripheral Interface，是串行外围设备接口，是一种高速，全双工，同步的通信总线。

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Verilog例化说明 1.什么是模块例化？为什么要例化？模块例化可以理解成模块调用。对于一个FPGA工程，通常是由一个顶层模块与多个功能子模块组成，...

2024-12-17 标签：Verilog 数码管显示显示模块 3.1k 0

在现代电子设计自动化（EDA）领域，Verilog作为一种硬件描述语言，已经成为数字电路设计和验证的标准工具。它允许设计师以高级抽象的方式定义电路的行为...

2024-12-17 标签：芯片硬件 Verilog 1.6k 0

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