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  • 基于DMA方式的实时数据采集处理系统设计

    )设计控制tms320vc5402信号及其响应信号。 考虑上述问题，采用aduc841与tms320vc5402的双cpu系统结构如图1所示。存储器hm62256既是tms320vc5402的全局数据存储器，又是aduc841的外部存储器。a15为片选信号，地址范围为8000h～ffffh。两个cpu分别通过总线和数据存储器hm62256相连，实现存储器共享。 隔离电路采用4片74lvc245双向缓冲器实现，由于aduc841的p0口是分时复用的地址／数据总线，所以需采用一片74lvc373地址锁存器将p0端口的地址信号从地址／数据总线中分离出来。而aduc841的16位数据总线需要双向缓冲，由于aduc841要对hm62256进行读写操作，所以缓冲器的方向由aduc841的读信号rd控制，当aduc841读数据时，rd为低电平，使数据缓冲方向为hm62256至aduc841；写数据时，rd为高电平，数据缓冲方向为aduc841至hm62256。缓冲器的使能线由a15反向信号控制，当a15为高电平时，选通缓冲器，否则缓冲器为高阻态。a15还是hm62256的片选信号，若要aduc8

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